TP5-BN_BCD-MUX/dinde.circ

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<project source="2.13.22" version="1.0">
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  <lib desc="#Wiring" name="0"/>
  <lib desc="#Gates" name="1"/>
  <lib desc="#Plexers" name="2">
    <tool name="Multiplexer">
      <a name="enable" val="false"/>
    </tool>
    <tool name="Demultiplexer">
      <a name="enable" val="false"/>
    </tool>
  </lib>
  <lib desc="#Arithmetic" name="3"/>
  <lib desc="#Memory" name="4">
    <tool name="RAM">
      <a name="contents">addr/data: 8 8
0
</a>
    </tool>
    <tool name="ROM">
      <a name="contents">addr/data: 8 8
0
</a>
    </tool>
  </lib>
  <lib desc="#I/O" name="5"/>
  <lib desc="#HDL-IP" name="6">
    <tool name="VHDL Entity">
      <a name="content">--------------------------------------------------------------------------------&#13;
-- HEIG-VD, institute REDS, 1400 Yverdon-les-Bains&#13;
-- Project :&#13;
-- File    :&#13;
-- Autor   :&#13;
-- Date    :&#13;
--&#13;
--------------------------------------------------------------------------------&#13;
-- Description :&#13;
--&#13;
--------------------------------------------------------------------------------&#13;
&#13;
library ieee;&#13;
  use ieee.std_logic_1164.all;&#13;
  --use ieee.numeric_std.all;&#13;
&#13;
entity VHDL_Component is&#13;
  port(&#13;
  ------------------------------------------------------------------------------&#13;
  --Insert input ports below&#13;
    horloge_i  : in  std_logic;                    -- input bit example&#13;
    val_i      : in  std_logic_vector(3 downto 0); -- input vector example&#13;
  ------------------------------------------------------------------------------&#13;
  --Insert output ports below&#13;
    max_o      : out std_logic;                    -- output bit example&#13;
    cpt_o      : out std_logic_Vector(3 downto 0)  -- output vector example&#13;
    );&#13;
end VHDL_Component;&#13;
&#13;
--------------------------------------------------------------------------------&#13;
--Complete your VHDL description below&#13;
architecture type_architecture of VHDL_Component is&#13;
&#13;
&#13;
begin&#13;
&#13;
&#13;
end type_architecture;&#13;
</a>
    </tool>
  </lib>
  <lib desc="#TCL" name="7">
    <tool name="TclGeneric">
      <a name="content">library ieee;&#13;
use ieee.std_logic_1164.all;&#13;
&#13;
entity TCL_Generic is&#13;
  port(&#13;
    --Insert input ports below&#13;
    horloge_i  : in  std_logic;                    -- input bit example&#13;
    val_i      : in  std_logic_vector(3 downto 0); -- input vector example&#13;
&#13;
	  --Insert output ports below&#13;
    max_o      : out std_logic;                    -- output bit example&#13;
    cpt_o      : out std_logic_Vector(3 downto 0)  -- output vector example&#13;
  );&#13;
end TCL_Generic;&#13;
</a>
    </tool>
  </lib>
  <lib desc="#Base" name="8">
    <tool name="Text Tool">
      <a name="text" val=""/>
      <a name="font" val="SansSerif plain 12"/>
      <a name="halign" val="center"/>
      <a name="valign" val="base"/>
    </tool>
  </lib>
  <lib desc="#BFH-Praktika" name="9"/>
  <lib desc="#FSM" name="10"/>
  <main name="main"/>
  <options>
    <a name="gateUndefined" val="ignore"/>
    <a name="simlimit" val="1000"/>
    <a name="simrand" val="0"/>
    <a name="tickmain" val="half_period"/>
  </options>
  <mappings>
    <tool lib="8" map="Button2" name="Menu Tool"/>
    <tool lib="8" map="Button3" name="Menu Tool"/>
    <tool lib="8" map="Ctrl Button1" name="Menu Tool"/>
  </mappings>
  <toolbar>
    <tool lib="8" name="Poke Tool"/>
    <tool lib="8" name="Edit Tool"/>
    <tool lib="8" name="Text Tool">
      <a name="text" val=""/>
      <a name="font" val="SansSerif plain 12"/>
      <a name="halign" val="center"/>
      <a name="valign" val="base"/>
    </tool>
    <sep/>
    <tool lib="0" name="Pin"/>
    <tool lib="0" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
      <a name="labelloc" val="east"/>
    </tool>
    <tool lib="1" name="NOT Gate"/>
    <tool lib="1" name="AND Gate"/>
    <tool lib="1" name="OR Gate"/>
  </toolbar>
  <circuit name="main">
    <a name="circuit" val="main"/>
    <a name="clabel" val=""/>
    <a name="clabelup" val="east"/>
    <a name="clabelfont" val="SansSerif bold 16"/>
    <a name="circuitnamedbox" val="true"/>
    <a name="circuitvhdlpath" val=""/>
    <wire from="(780,500)" to="(830,500)"/>
    <wire from="(780,1020)" to="(830,1020)"/>
    <wire from="(780,980)" to="(830,980)"/>
    <wire from="(580,700)" to="(580,710)"/>
    <wire from="(910,470)" to="(910,480)"/>
    <wire from="(780,1140)" to="(780,1150)"/>
    <wire from="(540,790)" to="(580,790)"/>
    <wire from="(540,670)" to="(580,670)"/>
    <wire from="(780,500)" to="(780,530)"/>
    <wire from="(860,870)" to="(900,870)"/>
    <wire from="(920,480)" to="(920,500)"/>
    <wire from="(610,650)" to="(610,670)"/>
    <wire from="(810,480)" to="(830,480)"/>
    <wire from="(860,690)" to="(880,690)"/>
    <wire from="(940,650)" to="(960,650)"/>
    <wire from="(730,640)" to="(750,640)"/>
    <wire from="(730,480)" to="(750,480)"/>
    <wire from="(730,600)" to="(750,600)"/>
    <wire from="(730,520)" to="(750,520)"/>
    <wire from="(730,680)" to="(750,680)"/>
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    <wire from="(830,640)" to="(830,670)"/>
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    <wire from="(790,510)" to="(790,590)"/>
    <wire from="(900,500)" to="(920,500)"/>
    <wire from="(810,420)" to="(810,480)"/>
    <wire from="(580,740)" to="(650,740)"/>
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    <wire from="(820,470)" to="(830,470)"/>
    <wire from="(780,590)" to="(790,590)"/>
    <wire from="(860,1030)" to="(870,1030)"/>
    <wire from="(830,880)" to="(830,930)"/>
    <wire from="(900,500)" to="(900,870)"/>
    <wire from="(780,640)" to="(830,640)"/>
    <wire from="(780,680)" to="(830,680)"/>
    <wire from="(780,760)" to="(830,760)"/>
    <wire from="(780,1040)" to="(830,1040)"/>
    <wire from="(870,1090)" to="(920,1090)"/>
    <wire from="(580,760)" to="(580,770)"/>
    <wire from="(910,450)" to="(910,460)"/>
    <wire from="(830,1050)" to="(830,1060)"/>
    <wire from="(590,680)" to="(650,680)"/>
    <wire from="(540,650)" to="(580,650)"/>
    <wire from="(790,1060)" to="(830,1060)"/>
    <wire from="(800,700)" to="(800,720)"/>
    <wire from="(780,1040)" to="(780,1060)"/>
    <wire from="(780,470)" to="(800,470)"/>
    <wire from="(900,430)" to="(920,430)"/>
    <wire from="(560,730)" to="(580,730)"/>
    <wire from="(870,450)" to="(870,490)"/>
    <wire from="(730,540)" to="(750,540)"/>
    <wire from="(730,380)" to="(750,380)"/>
    <wire from="(730,420)" to="(750,420)"/>
    <wire from="(730,460)" to="(750,460)"/>
    <wire from="(730,580)" to="(750,580)"/>
    <wire from="(730,820)" to="(750,820)"/>
    <wire from="(730,860)" to="(750,860)"/>
    <wire from="(730,940)" to="(750,940)"/>
    <wire from="(730,1020)" to="(750,1020)"/>
    <wire from="(730,1060)" to="(750,1060)"/>
    <wire from="(730,1100)" to="(750,1100)"/>
    <wire from="(730,980)" to="(750,980)"/>
    <wire from="(780,420)" to="(810,420)"/>
    <wire from="(940,650)" to="(940,1130)"/>
    <wire from="(880,480)" to="(910,480)"/>
    <wire from="(1010,490)" to="(1010,650)"/>
    <wire from="(580,710)" to="(650,710)"/>
    <wire from="(860,1160)" to="(870,1160)"/>
    <wire from="(830,810)" to="(830,860)"/>
    <wire from="(780,930)" to="(830,930)"/>
    <wire from="(780,810)" to="(830,810)"/>
    <wire from="(780,1170)" to="(830,1170)"/>
    <wire from="(540,650)" to="(540,660)"/>
    <wire from="(870,1100)" to="(920,1100)"/>
    <wire from="(580,730)" to="(580,740)"/>
    <wire from="(580,650)" to="(580,660)"/>
    <wire from="(780,1170)" to="(780,1180)"/>
    <wire from="(550,690)" to="(550,760)"/>
    <wire from="(830,980)" to="(830,1010)"/>
    <wire from="(790,510)" to="(830,510)"/>
    <wire from="(780,380)" to="(820,380)"/>
    <wire from="(800,470)" to="(800,490)"/>
    <wire from="(920,430)" to="(920,450)"/>
    <wire from="(590,660)" to="(590,680)"/>
    <wire from="(880,480)" to="(880,690)"/>
    <wire from="(780,720)" to="(800,720)"/>
    <wire from="(750,340)" to="(900,340)"/>
    <wire from="(790,1060)" to="(790,1100)"/>
    <wire from="(540,680)" to="(560,680)"/>
    <wire from="(550,760)" to="(580,760)"/>
    <wire from="(800,490)" to="(830,490)"/>
    <wire from="(870,1100)" to="(870,1160)"/>
    <wire from="(580,800)" to="(650,800)"/>
    <wire from="(910,460)" to="(920,460)"/>
    <wire from="(860,490)" to="(870,490)"/>
    <wire from="(540,690)" to="(550,690)"/>
    <comp lib="0" loc="(750,370)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="C"/>
      <a name="labelfont" val="SansSerif bold 6"/>
    </comp>
    <comp lib="0" loc="(750,510)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="B"/>
      <a name="labelfont" val="SansSerif bold 6"/>
    </comp>
    <comp lib="0" loc="(610,760)" name="Tunnel">
      <a name="label" val="NB"/>
    </comp>
    <comp lib="1" loc="(780,870)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="4"/>
    </comp>
    <comp lib="0" loc="(750,650)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="NC"/>
      <a name="labelfont" val="SansSerif bold 6"/>
    </comp>
    <comp lib="0" loc="(610,700)" name="Tunnel">
      <a name="label" val="ND"/>
    </comp>
    <comp lib="0" loc="(750,1050)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="B"/>
      <a name="labelfont" val="SansSerif bold 6"/>
    </comp>
    <comp lib="1" loc="(610,760)" name="NOT Gate"/>
    <comp lib="0" loc="(750,730)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="ND"/>
      <a name="labelfont" val="SansSerif bold 6"/>
    </comp>
    <comp lib="0" loc="(650,740)" name="Tunnel">
      <a name="label" val="C"/>
    </comp>
    <comp lib="0" loc="(750,1130)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="A"/>
      <a name="labelfont" val="SansSerif bold 6"/>
    </comp>
    <comp lib="0" loc="(650,770)" name="Tunnel">
      <a name="label" val="B"/>
    </comp>
    <comp lib="0" loc="(750,970)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="B"/>
      <a name="labelfont" val="SansSerif bold 6"/>
    </comp>
    <comp lib="8" loc="(568,744)" name="Text">
      <a name="text" val="C"/>
      <a name="font" val="SansSerif plain 12"/>
    </comp>
    <comp lib="1" loc="(780,1180)" name="AND Gate">
      <a name="size" val="30"/>
    </comp>
    <comp lib="0" loc="(730,720)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="NC"/>
      <a name="labelfont" val="SansSerif bold 6"/>
    </comp>
    <comp lib="0" loc="(920,1110)" name="Constant">
      <a name="value" val="0x0"/>
    </comp>
    <comp lib="0" loc="(610,790)" name="Tunnel">
      <a name="label" val="NA"/>
    </comp>
    <comp lib="8" loc="(569,664)" name="Text">
      <a name="text" val="E"/>
      <a name="font" val="SansSerif plain 12"/>
    </comp>
    <comp lib="0" loc="(730,460)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="A"/>
      <a name="labelfont" val="SansSerif bold 6"/>
    </comp>
    <comp lib="0" loc="(750,830)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="ND"/>
      <a name="labelfont" val="SansSerif bold 6"/>
    </comp>
    <comp lib="1" loc="(610,790)" name="NOT Gate"/>
    <comp lib="0" loc="(730,480)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="B"/>
      <a name="labelfont" val="SansSerif bold 6"/>
    </comp>
    <comp lib="8" loc="(981,679)" name="Text">
      <a name="text" val="dizaine"/>
      <a name="font" val="SansSerif plain 12"/>
    </comp>
    <comp lib="8" loc="(568,705)" name="Text">
      <a name="text" val="D"/>
      <a name="font" val="SansSerif plain 12"/>
    </comp>
    <comp lib="0" loc="(750,550)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="ND"/>
      <a name="labelfont" val="SansSerif bold 6"/>
    </comp>
    <comp lib="0" loc="(730,1020)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="C"/>
      <a name="labelfont" val="SansSerif bold 6"/>
    </comp>
    <comp lib="0" loc="(750,630)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="A"/>
      <a name="labelfont" val="SansSerif bold 6"/>
    </comp>
    <comp lib="1" loc="(860,1160)" name="OR Gate">
      <a name="size" val="30"/>
    </comp>
    <comp lib="0" loc="(730,380)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="D"/>
      <a name="labelfont" val="SansSerif bold 6"/>
    </comp>
    <comp lib="0" loc="(750,490)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="NC"/>
      <a name="labelfont" val="SansSerif bold 6"/>
    </comp>
    <comp lib="0" loc="(750,950)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="ND"/>
      <a name="labelfont" val="SansSerif bold 6"/>
    </comp>
    <comp lib="0" loc="(750,850)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="A"/>
      <a name="labelfont" val="SansSerif bold 6"/>
    </comp>
    <comp lib="0" loc="(750,910)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="B"/>
      <a name="labelfont" val="SansSerif bold 6"/>
    </comp>
    <comp lib="1" loc="(780,380)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="3"/>
    </comp>
    <comp lib="1" loc="(780,980)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="3"/>
    </comp>
    <comp lib="1" loc="(780,810)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="4"/>
    </comp>
    <comp lib="1" loc="(860,870)" name="OR Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="3"/>
    </comp>
    <comp lib="0" loc="(940,1130)" name="Splitter">
      <a name="facing" val="west"/>
      <a name="fanout" val="4"/>
      <a name="incoming" val="4"/>
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    </comp>
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    </comp>
    <comp lib="1" loc="(780,640)" name="AND Gate">
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    </comp>
    <comp lib="1" loc="(780,420)" name="AND Gate">
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    </comp>
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      <a name="label" val="C"/>
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    </comp>
    <comp lib="1" loc="(780,1140)" name="AND Gate">
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    </comp>
    <comp lib="1" loc="(610,650)" name="NOT Gate"/>
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    </comp>
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    </comp>
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    </comp>
    <comp lib="1" loc="(780,1100)" name="AND Gate">
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    </comp>
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    </comp>
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    </comp>
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    </comp>
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    </comp>
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    </comp>
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    </comp>
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    </comp>
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    </comp>
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    </comp>
    <comp lib="1" loc="(610,730)" name="NOT Gate"/>
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    </comp>
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    </comp>
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    </comp>
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    </comp>
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    </comp>
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    </comp>
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    </comp>
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    </comp>
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    </comp>
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    </comp>
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    </comp>
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    </comp>
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    </comp>
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    </comp>
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    </comp>
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    </comp>
    <comp lib="1" loc="(860,1030)" name="OR Gate">
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    </comp>
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    </comp>
  </circuit>
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